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Cramer-Rao lower bounds for QAM phase and frequency estimation.
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Rice, F.
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Test pattern generation and partial-scan methodology for an asynchronous SoC interconnect.
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Efthymiou, A.
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Linearization of the timing analysis and optimization of level-sensitive digital synchronous circuits.
por
Taskin, B.
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IEEE Transactions on VLSI systems
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Efthymiou, A.
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Taskin, B.
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