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SOC test planning using virtual test access architectures.
Por
Sehgal, A.
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IEEE Transactions on VLSI systems
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Wrapper design for multifrequency IP cores.
Por
Qiang Xu
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IEEE Transactions on VLSI systems
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Diagnosis of single stuck-at faults and multiple timing faults in scan chains.
Por
Chien-Mo Li, J.
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IEEE Transactions on VLSI systems
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Nine-coded compression technique for testing embedded cores in SoCs.
Por
Tehranipoor, M.
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IEEE Transactions on VLSI systems
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Test data compression technique for embedded cores using virtual scan chains.
Por
Jas, A.
Publicado no
IEEE Transactions on VLSI systems
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Layout driven synthesis of multiple scan chains.
Por
Rahimi, K.
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IEEE Transactions on computer-aided design of integrated circuits and systems
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Union Catalog (Buklod)
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Chien-Mo Li, J.
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Jas, A.
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Qiang Xu
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Rahimi, K.
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Sehgal, A.
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Tehranipoor, M.
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Artigo
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