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Unification of scheduling, binding, and retiming to reduce power consumption under timings and resources constraints.
par
Chabini, N.
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Efficient metrics and high-level synthesis for dynamically reconfigurable logic.
par
Meribout, M.
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Algorithm level recomputing using allocation diversity a register transfer level approach to time redundancy-based concurrent error detection.
par
Kaijie Wu
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Automatic test pattern generation for functional register-transfer level circuits using assignment decision diagrams.
par
Ghosh, I.
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Memory binding for performance optimization of control-flow intensive behavioral descriptions.
par
Khouri, K.S
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Overview of a compiler for synthesizing MATLAB programs onto FPGAs.
par
Banerjee, P.
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