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A novel FPGA architecture supporting wide, shallow memories.
Veröffentlicht in IEEE Transactions on VLSI systemsArtikel -
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A robust self-calibrating transmission scheme for on-chip networks.
Veröffentlicht in IEEE Transactions on VLSI systemsArtikel -
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Reconfigurable instruction set processors from a hardware
Veröffentlicht in IEEE Transactions on software engineeringArtikel -
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Reverse-body bias and supply collapse for low effective standby power.
Veröffentlicht in IEEE Transactions on VLSI systemsArtikel -
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Low-power instruction bus encoding for embedded processors.
Veröffentlicht in IEEE Transactions on VLSI systemsArtikel -
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