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    A 6-GSamples/s multi-level decision feedback equalizer embedded in a 4-bit time-interleaved pipeline A द्वारा Varzaghani, A.

    में प्रकाशित IEEE Journal of solid state circuits
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  2. 2

    A 10-Gb/s CMU द्वारा Centurelli, F.

    में प्रकाशित IEEE Transactions on VLSI systems
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