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  1. 1

    An architecture and compiler for scalable on-chip communication. द्वारा Jian Liang

    में प्रकाशित IEEE Transactions on VLSI systems
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  2. 2

    Design of a 3-D fully depleted SOI computational RAM. द्वारा Koob, J.C

    में प्रकाशित IEEE Transactions on VLSI systems
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    A 10-b 150-MSample/s 1.8-V 123-mW CMOS A द्वारा Jong-Bum Park

    में प्रकाशित IEEE Journal of solid state circuits
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    Communications technology guidelines for EMS द्वारा Marihart, D.J

    में प्रकाशित IEEE Transactions on power delivery
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