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    Design and implementation of pipelined analog-to-digital converters in a 90nm CMOS process द्वारा Dizon, Aaron Galvez

    थीसिस

    Design and implementation of pipelined analog-to-digital converters in a 90nm CMOS process
  2. 2

    A 10-b 150-MSample/s 1.8-V 123-mW CMOS A द्वारा Jong-Bum Park

    में प्रकाशित IEEE Journal of solid state circuits
    लेख

    A 10-b 150-MSample/s 1.8-V 123-mW CMOS A
  3. 3

    Low-power pipeline ADC for wireless LANs. द्वारा Arias, J.

    में प्रकाशित IEEE Journal of solid state circuits
    लेख

    Low-power pipeline ADC for wireless LANs.
  4. 4

    A 1.4-V 10-bit 25-MS द्वारा Dong-Young Chang

    में प्रकाशित IEEE Journal of solid state circuits
    लेख

    A 1.4-V 10-bit 25-MS
  5. 5

    A 12-bit 75-MS द्वारा Murmann, B.

    में प्रकाशित IEEE Journal of solid state circuits
    लेख

    A 12-bit 75-MS
  6. 6

    Impact of capacitor dielectric relaxation on a 14-bit 70-MS द्वारा Zanchi, A.

    में प्रकाशित IEEE Journal of solid state circuits
    लेख

    Impact of capacitor dielectric relaxation on a 14-bit 70-MS
  7. 7

    A 14-bit digitally self-calibrated pipelined ADC with adaptive bias optimization for arbitrary speeds up to 40 MS द्वारा Iizuka, K.

    में प्रकाशित IEEE Journal of solid state circuits
    लेख

    A 14-bit digitally self-calibrated pipelined ADC with adaptive bias optimization for arbitrary speeds up to 40 MS

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