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    Design and implementation of pipelined analog-to-digital converters in a 90nm CMOS process por Dizon, Aaron Galvez

    Tesis

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    A 10-b 150-MSample/s 1.8-V 123-mW CMOS A por Jong-Bum Park

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    Low-power pipeline ADC for wireless LANs. por Arias, J.

    Artículo

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    A 1.4-V 10-bit 25-MS por Dong-Young Chang

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    A 12-bit 75-MS por Murmann, B.

    Artículo

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    Impact of capacitor dielectric relaxation on a 14-bit 70-MS por Zanchi, A.

    Artículo

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    A 14-bit digitally self-calibrated pipelined ADC with adaptive bias optimization for arbitrary speeds up to 40 MS por Iizuka, K.

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    A 14-bit digitally self-calibrated pipelined ADC with adaptive bias optimization for arbitrary speeds up to 40 MS

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