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    An integration-biased BER-aware design methodology of a BPSK transceiver front-end for power line sensor nodes par Ortiz, Joana Rochelle R.

    Publié 2014
    Thèse

    An integration-biased BER-aware design methodology of a BPSK transceiver front-end for power line sensor nodes
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    PVT-aware digital techniques for low-power, 0.5V, on-chip processing unit for the SmartWire node in 65nm CMOS process par Sebastian, Sherry Joy Alvionne

    Publié 2014
    Thèse

    PVT-aware digital techniques for low-power, 0.5V, on-chip processing unit for the SmartWire node in 65nm CMOS process

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