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    Power optimized partial scan BIST implementation on DLX microprocessor 著者: Buenaventura, Arvi D.

    学位論文


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  2. 2

    Automatic testing and evaluation of digital integrated circuits 著者: Healy, James Thomas 1940-

    出版事項 1981
    図書


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  3. 3

    Power reduction techniques and BIST implementation on a DLX microprocessor using a 90nm CMOS process 著者: Agbayani, Jay-ar Anacleto

    出版事項 2010
    学位論文


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  4. 4

    Tutorial test generation for VLSI chips

    出版事項 1988
    図書


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